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カコモンノート›応用情報技術者›平成30年度 春期コンピュータシステム

問23応用情報技術者 平成30年度 春期

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平成30年度 春期2018年

ワンチップマイコンにおける内部クロック発生器のブロック図を示す。15 MHzの発振器と，内部のPLL1，PLL2及び分周器の組合せでCPUに240 MHz，シリアル通信（SIO）に115 kHzのクロック信号を供給する場合の分周器の値は幾らか。ここで，シリアル通信のクロック精度は±5%以内に収まればよいものとする。

この問題の図
問題に添えられた図。出典は下に書いています。

選択肢をえらぶと、答えと解説が出ます

選択肢をえらぶと、
ここに答えと解説が出ます
正答 4

解説

正解は4。分周器に入るのは、発振器の15MHzをPLL1で8逓倍した信号である。
15MHz×8＝120MHz（これをPLL2で2逓倍した240MHzがCPU向け）
分周器では120MHzを1/2ⁿにしてSIO用の115kHz±5%（約109.25〜120.75kHz）に収める。
1/2¹⁰：120,000kHz÷1,024 ≒ 117.2kHz　範囲内
1/2⁸：120,000kHz÷256 ≒ 468.8kHz　範囲外
よって1/2¹⁰が当てはまる。

  • 1の1/2⁴は120MHz÷16＝7.5MHzで、大きく外れる。
  • 2の1/2⁶は120MHz÷64 ≒ 1.875MHzで、外れる。
  • 3の1/2⁸は約468.8kHzで、115kHzの4倍ほどになり外れる。

根拠：PLLによる逓倍と分周器による周波数の分割の計算。

KEY POINT
分周比は入力周波数÷目標周波数で見当をつけ、許容誤差の範囲に入る2のべき乗を選ぶ。
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出典：平成30年度 春期 応用情報技術者試験 午前 問23（独立行政法人 情報処理推進機構（IPA））
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